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资料编号:168768
 
资料名称:MAX144BEPA
 
文件大小: 240.67K
   
说明
 
介绍:
+2.7V, Low-Power, 2-Channel, 108ksps, Serial 12-Bit ADCs in 8-Pin レMAX
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
_______________详细地 描述
这 max144/max145 相似物-至-数字的 转换器
(adcs) 使用 一个 successive-approximation 转换
(sar) 技巧 和 在-碎片 追踪-和-支撑 (t/h)
结构 至 转变 一个 相似物 信号 至 一个 串行 12-位
数字的 输出 数据 stream.
这个 有伸缩性的 串行 接口 提供 容易 接口 至
微处理器 (µps). 图示 2 显示 一个 simplified
函数的 图解 的 这 内部的 architecture 为 两个都
这 max144 (2 途径, 单独的-结束) 和 这 max145
(1 频道, pseudo-差别的).
相似物 输入: 单独的-结束 (max144)
和 pseudo-差别的 (max145)
这 抽样 architecture 的 这 模数转换器’s 相似物 com-
parator 是 illustrated 在 这 相等的 输入 电路 的
图示 3. 在 单独的-结束 模式 (max144), 两个都 chan-
nels ch0 和 ch1 是 涉及 至 地 和 能 是
连接 至 二 不同的 信号 来源. 下列的 这
电源-在 重置, 这 模数转换器 是 设置 至 转变 ch0. 之后
ch0 有 被 转变, ch1 将 是 转变 和
这 conversions 将 continue 至 alternate 在
途径. 频道 切换 是 执行 用 toggling
CS
/shdn 管脚. conversions 能 是 执行 在
这 一样 频道 用 toggling
CS
/shdn 两次 在
conversions. 如果 仅有的 一个 频道 是 必需的, ch0 和
ch1 将 是 连接 一起; 不管怎样, 这 输出
数据 将 安静的 包含 这 频道 identification 位
(在之前 这 msb).
为 这 max145, 这 输入 途径 表格 一个 单独的 differ-
ential 频道 一双 (ch+, ch-). 这个 配置 是
pseudo-差别的 至 这 效应 那 仅有的 这 信号 在
in+ 是 抽样. 这 返回 一侧 在- 必须 仍然是 稳固的
在里面 ±0.5lsb (±0.1lsb 为 最佳的 结果) 和
遵守 至 地 在 一个 转换. 至 accomplish
这个, 连接 一个 0.1µf 电容 从 在- 至 地.
在 这 acquisition 间隔, 这 频道 选择 作
这 积极的 输入 (in+) charges 电容 c
支撑
. 这
acquisition 间隔 spans 从 当
CS
/shdn falls 至
这 下落 边缘 的 这 第二 时钟 循环 (外部
时钟 模式) 或者 从 当
CS
/shdn falls 至 这 第一
下落 边缘 的 sclk (内部的 时钟 模式). 在 这 终止
的 这 acquisition 间隔, 这 t/h 转变 opens, retain-
ing 承担 在 c
支撑
作 一个 样本 的 这 信号 在 in+.
这 转换 间隔 begins 和 这 输入 multiplex-
er 切换 c
支撑
从 这 积极的 输入 (in+) 至 这
负的 输入 (在-). 这个 unbalances node 零 在 这
比较器’s 积极的 输入.
max144/max145
+2.7v, 低-电源, 2-频道, 108ksps,
串行 12-位 adcs 在 8-管脚 µmax
_______________________________________________________________________________________ 7
6k C
L
DOUT
一个)
高-z 至 v
0H
, v
0L
至 v
0H
, 和 v
OH
至 高-z
6k
C
L
DOUT
GNDGND
V
DD
b)
高-z 至 v
0L
, v
0H
至 v
0L
, 和 v
OL
至 高-z
图示 1. 加载 电路 为 使能 和 使不能运转 时间
MAX144
MAX145
12-位
SAR
模数转换器
SCLK
( ) 是 为 max145
输出
相似物
输入
MUX
(2 频道)
CH0
(ch+)
CH1
(ch-)
REF
t/h
控制
逻辑
SCLK
cs/shdn
内部的
时钟
输出
寄存器
DOUT
图示 2. simplified 函数的 图解
CH0
(ch+)
CH1
(ch-)
( ) 是 为 max145
单独的-结束 模式: ch0, ch1 = in+; 地 = in-
差别的-结束 模式: ch+ = in+; ch- = in-
R
9k
REF
追踪
支撑
比较器
至 sar
t/h
C
支撑
16pF
输入
MUX
12-位 电容的 dac
C
转变
控制 逻辑
MAX144
MAX145
图示 3. 相似物 输入 频道 结构
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