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CLC5903
clc5903vla 引脚
管脚 描述
信号 pqfp 管脚 fbga 管脚 描述
MR 45 M4
主控 重置,
起作用的 低
resets 所有 寄存器 在里面 这 碎片.
ASTROBE
和
BSTROBE
是 asserted 在
MR
.
ain[13:0],
bin[13:0]
4:10,12:18,
22:28,
30:36
d3,a1,c2,
b1,e4,d2,
c1,e3,d1,
f4,f3,e1,
e2,g4;
g2,g3,h2,
h1,h3,j2,
j1,j3,h4,
k1,j4,k2,
l1,k3
输入 数据,
起作用的 高
2’s complement 输入 数据.
AIN[13]
和
BIN[13]
是 这 msbs. 这 数据 是 clocked
在 这 碎片 在 这 rising 边缘 的 这 相应的 时钟 (
CKA
,
CKB
). 这
clc595x connects 直接地 至 这些 输入 管脚 和 非 额外的 逻辑. 系 unused
输入 位 低.
17
16
14
11
9
8
6
4
2
1
15
13
12
10
7
5
3
20
19
18
24
22
21
VDD
BIN[12]
25
23
(msb) bin[13]
BIN[11]
BIN[10]
NC
VSSIO
AIN[11]
AIN[9]
AIN[8]
VDDIO
AIN[4]
AIN[2]
AIN[1]
NC
(msb) ain[13]
AIN[12]
AIN[10]
AIN[7]
AIN[6]
AIN[5]
AIN[3]
VSS
CKA
AIN[0]
36
34
33
31
29
27
26
38
37
35
32
30
28
BIN[9]
BIN[7]
BIN[5]
BIN[3]
BIN[2]
BIN[0]
BIN[8]
VSSIO
BIN[6]
BIN[4]
BIN[1]
NC
CKB
86
87
89
92
94
95
97
99
101
102
88
90
91
93
96
98
100
83
84
85
79
81
82
AOUT
SCK
78
80
SFS
VDDIO
BOUT
NC
NC
POUT[5]
POUT[7]
POUT[8]
VDDIO
VSSIO
POUT[13]
POUT[14]
NC
sck_在
VSSIO
POUT[6]
POUT[9]
POUT[10]
POUT[11]
POUT[12]
POUT[15]
VSSIO
VDD
67
69
70
72
74
76
77
65
66
68
71
73
75
RDY
D[0]
D[2]
D[4]
D[5]
NC
VSS
VDD
D[1]
D[3]
VSSIO
NC
NC
124
125
127
126
128
121
122
123
117
119
120
VSS
TMS
116
118
TCK
TDI
TDO
AGAIN[2]
AGAIN[0]
ASTROBE
VDDIO
AGAIN[1]
scan_en
TRST
NC
105
107
108
110
112
114
115
103
104
106
109
111
113
VDD
pout_sel[1]
VSSIO
POUT[1]
VDDIO
POUT[3]
pout_sel[0]
pout_sel[2]
pout_en
POUT[0]
POUT[2]
POUT[4]
VSS
60
61
63
62
64
57
58
59
53
55
56
A[1]
A[3]
52
54
A[2]
A[4]
A[5]
D[6]
VSSIO
CE
VDDIO
D[7]
WR
A[0]
RD
41
43
44
46
48
50
51
39
40
42
45
47
49
VSS
VDD
SI
NC
BSTROBE
BGAIN[1]
A[6]
A[7]
VSSIO
MR
BGAIN[0]
BGAIN[2]
VDDIO
CLC5903VLA
双 数字的 tuner / agc
(顶 视图)
图示 4. clc5903vla pqfp 引脚
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