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资料编号:243322
 
资料名称:SN65MLVD080DGG
 
文件大小: 239.45K
   
说明
 
介绍:
8 CHANNEL HALF DUPLEX M LVDS LINE TRANSCEIVERS
 
 


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
slls581a −九月 2003 − 修订 九月 2003
www.德州仪器.com
6
接受者 切换 特性
推荐 运行 情况 除非 否则 指出
参数 测试 情况 最小值 典型值
(1)
最大值 单位
t
pLH
传播 延迟 时间, 低-至-高-水平的 输出
2 4 6 ns
t
pHL
传播 延迟 时间, 高-至-低-水平的 输出
2 4 6 ns
t
r
输出 信号 上升 时间
1 2.3 ns
t
f
输出 信号 下降 时间
C
L
= 15 pf, 看 图示 10
1 2.3 ns
t
sk(o)
输出 skew
C
L
= 15 pf, 看 图示 10
350 ps
t
sk(p)
脉冲波 skew (|t
pHL
− t
pLH
|)
50 350 ps
t
sk(pp)
部分-至-部分 skew
(2)
1 ns
t
jit(每)
时期 jitter, rms (1 标准 背离)
(3)
100 mhz 时钟 输入
(4)
7 ps
t
jit(c−c)
循环-至-循环 jitter, rms
100 mhz 时钟 输入
(4)
110 ps
t
jit(det)
deterministic jitter
类型 1 550 ps
t
jit(det)
deterministic jitter
类型 2
200 mbps 2
15
−1 prbs 输入
(5)
480 ps
t
jit(pp)
顶峰-至-顶峰 jitter
(3)(6)
类型 1
200 mbps 2
15
−1 prbs 输入
(5)
720 ps
t
jit(pp)
顶峰-至-顶峰 jitter
(3)(6)
类型 2 660 ps
t
pZH
使能 时间, 高-阻抗-至-高-水平的 输出
30 ns
t
pZL
使能 时间, 高-阻抗-至-低-水平的 输出
C
L
= 15 pf, 看 图示 11
30 ns
t
pHZ
使不能运转 时间, 高-水平的-至-高-阻抗 输出
C
L
= 15 pf, 看 图示 11
18 ns
t
pLZ
使不能运转 时间, 低-水平的-至-高-阻抗 输出
28 ns
(1)
所有 典型 值 是 在 25
°
c 和 和 一个 3.3-v 供应 电压.
(2)
hp4194a 阻抗 分析器 (或者 相等的)
(3)
jitter 是 保证 用 设计 和 描绘. stimulus jitter 有 被 subtracted 从 这 号码.
(4)
V
ID
= 200 mv
pp
(’080), v
ID
= 400 mv
pp
(’082), v
cm
= 1 v, t
r
= t
f
= 0.5 ns (10% 至 90%), 量过的 在 30 k 样本.
(5)
V
ID
= 200 mv
pp
(’080), v
ID
= 400 mv
pp
(’082), v
cm
= 1 v, t
r
= t
f
= 0.5 ns (10% 至 90%), 量过的 在 100 k 样本.
(6)
顶峰-至-顶峰 jitter 包含 jitter 预定的 至 脉冲波 skew (t
sk(p)
).
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