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资料编号:243322
 
资料名称:SN65MLVD080DGG
 
文件大小: 239.45K
   
说明
 
介绍:
8 CHANNEL HALF DUPLEX M LVDS LINE TRANSCEIVERS
 
 


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slls581a −九月 2003 − 修订 九月 2003
www.德州仪器.com
9
一个
B
0 v 或者 v
CC
1.62 k
,
±
1%
V
一个
或者 v
B
图示 7. 最大 稳步的 状态 输出 电压
t
c(n)
1/f0
0 v
0 v
时期 jitter
0 v
顶峰 至 顶峰 jitter
1/f0
prbs 输入
输出
V
一个
−V
B
V
一个
−V
B
时钟
输入
完美的
输出
真实的
输出
V
CC
V
CC
/2
t
jit(每)
=
t
c(n)
−1/f0
t
jit(pp)
0 v
V
CC
V
CC
/2
0 v
V
一个
−V
B
V
一个
−V
B
循环 至 循环 jitter
0 v
V
一个
− v
B
输出
t
c(n)
t
c(n+1)
t
jit(cc)
= | t
c(n)
− t
c(n+1)
|
注释:一个. 所有 输入 脉冲 是 有提供的 用 一个 agilent 8304a stimulus 系统 和 plug-在 tbd.
b. 这 度量 是 制造 在 一个 tek tds6604 运动 tdsjit3 应用 软件
c. 时期 jitter 和 循环-至-循环 jitter 是 量过的 使用 一个 100 mhz 50
±
1% 职责 循环 时钟 输入.
d. 顶峰-至-顶峰 jitter 和 deterministic jitter 是 量过的 使用 一个 200 mbps 2
15
−1 prbs 输入.
图示 8. 驱动器 jitter 度量 波形
(v
一个
+ v
B
)/2
I
O
R
V
CM
V
O
V
ID
V
一个
I
一个
一个
B
I
B
V
B
图示 9. 接受者 电压 和 电流 定义
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