DP83902AV_集成电路资料查询网

40 函数的 描述
(持续)
这些 四 信号 是 resistively combined TXO
一个
和
TXOd
b
和 TXO
b
和 TXOd
一个
 这个 是 知道 作 数字的
前-emphasis 和 是 必需的 至 compensate 为 这 twisted
一双 缆索 这个 acts 像 一个 低 通过 过滤 造成 更好
attenuation 至 这 10 MHz (50 ns) 脉冲 的 这 Manchester
encoded 波形 比 这 5 MHz (100 ns) pulses
一个 例子 的 如何 这些 信号 是 联合的 是 显示 在
这 下列的 diagram
TLF11157–6
这 信号 和 前-emphasis 显示 在之上 是 发生 用
resistively 结合 TXO
一个
和 TXOd
b
 这个 信号 along
和 它的 complement 是 passed 至 这 transmit filter
状态 信息
状态 信息 是 提供 用 这 st-nic 在 这
CRSRX TXETX COL 和 POL 输出 作 描述 在
这 管脚 描述 table 这些 输出 是 合适的 为 driv-
ing 状态 LEDs 通过 一个 适合的 驱动器 circuit
这 POL 输出 是 正常情况下 low 和 将 是 驱动 高
当 七 consecutive link 脉冲 或者 三 consecutive
receive packets 是 发现 和 使反转 polarity 一个 polar-
ity 倒置 能 是 造成 用 一个 线路 错误 在 也 终止 的
这 TPI cable 在 发现 的 一个 极性 倒置 这 condi-
tion 是 latched 和 POL 是 asserted 这 TPI corrects 为 这个
错误 内部 和 将 decode received 数据 correctly elim-
inating 这 需要 至 准确无误的 这 线路 error
ENCODERDECODER (endec) 单元
这 ENDEC 组成 的 三 主要的 logical blocks
一个) 这 Manchester encoder accepts NRZ 数据 从 这
controller encodes 这 数据 至 Manchester 和 trans-
mits 它 differentially 至 这 transceiver 通过 这 differ-
ential transmit driver
b) 这 Manchester 解码器 receives Manchester 数据 从
这 transceiver converts 它 至 NRZ 数据 和 时钟 pulses
和 发送 它 至 这 controller
c) 这 collision 翻译 indicates 至 这 控制 这
存在 的 一个 有效的 10 MHz collision 信号 至 这 PLL
MANCHESTER ENCODER 和 差别的 驱动器
这 差别的 transmit pair 在 这 secondary 的 这 trans-
former 驱动 向上 至 50 计量表 的 twisted 一双 AUI cable
这些 输出 是 源 followers 这个 需要 二 270
X
拉-向下 电阻器 至 ground
这 DP83902A 准许 两个都 half-步伐 和 全部-步伐 至 是
兼容 和 Ethernet 和 IEEE 8023 和 这 SEL 管脚
低 (为 Ethernet i) Transmit
一个
是 积极的 和 遵守 至
Transmit
b
在 idle 和 SEL 高 (为 IEEE 8023)
Transmit
一个
和 Transmit
b
是 equal 在 这 空闲 state 这个
提供 零 差别的 电压 至 运作 和 transform-
er 结合 loads
MANCHESTER 解码器
这 解码器 组成 的 一个 差别的 接受者 和 一个 PLL 至
独立的 一个 Manchester 解码 数据 stream 在 内部的
时钟 信号 和 data 这 差别的 输入 必须 是 exter-
nally terminated 和 二 39
X
电阻器 连接 在 序列
如果 这 标准 78
X
transceiver 漏出 缆索 是 used 在 薄的
Ethernet applications 这些 电阻器 是 optional 至 前-
vent 噪音 从 falsely triggering 这 decoder 一个 squelch
电路 在 这 输入 rejects 信号 和 水平 较少 比
b
175 mV 信号 更多 负的 比
b
300 mV 是 de-
coded 数据 变为 有效的 典型地 在里面 5 位 times 这
DP83902A 将 tolerate 位 jitter 向上 至 18 ns 在 这 received
data 这 解码器 发现 这 终止 的 一个 框架 当 非 更多
mid-位 transitions 是 detected
COLLISION 翻译
当 在 AUI mode 当 这 Ethernet transceiver (dp8392
cti) 发现 一个 collision 它 发生 一个 10 MHz 信号 至 这
差别的 collision 输入 (cd
g
) 的 这 DP83902A 当
这些 输入 是 发现 active 这 DP83902A 使用 这个
信号 至 后面的 止 它的 电流 传递 和 reschedule
另一 one
这 collision 差别的 输入 是 terminated 这 一样 方法
作 这 差别的 receive inputs 这 squelch 电路系统 是
也 similar rejecting 脉冲 和 水平 较少 比
b
175 mV
CRYSTALOSCILLATOR 运作
OCSILLATOR
这 振荡器 是 控制 用 一个 20 MHz 并行的 resonant
结晶 连接 在 X1 和 X2 或者 用 一个 外部
时钟 在 X1 这 20 MHz 输出 的 这 振荡器 是 分隔
用 2 至 发生 这 10 MHz transmit 时钟 为 这 控制-
ler 这 振荡器 也 提供 内部的 时钟 信号 至 这
encoding 和 解码 circuits
Note
当 X1 是 正在 驱动 用 一个 外部 oscillator X2 必须 是
grounded
结晶 规格
Resonant 频率 20 MHz
容忍
g
0005% 在 25

C
稳固
g
0005% 在 0

C–70

C
类型 在 截
电路 并行的 Resonance
最大值 等效串联电阻 25
X
结晶 加载 电容 20 pF
这 20 MHz 结晶 连接 至 这 DP83902 需要
特定的 care 这 IEEE 8023 标准 需要 这 trans-
mitted 信号 频率 至 是 精确 在里面
g
001%
偏离 电容 能 变换 这 crystal’s 频率 输出 的
范围 和 导致 transmitted 频率 至 超过 它的 001%
tolerance 这 频率 marked 在 这 结晶 是 通常地
量过的 和 一个 fixed 加载 电容 指定 在 这
crystal’s 数据 sheet 典型地 20 pF
10

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40 函数的描述 (持续) 这些四信号是 resistively combined TXO 一个和 TXOd b 和 TXO b 和 TXOd 一个  这个是知道作数字的前-emphasis 和是必需的至 compensate 为这 twisted 一双缆索这个 acts 像一个低通过过滤造成更好 attenuation 至这 10 MHz (50 ns) 脉冲的这 Manchester encoded 波形比这 5 MHz (100 ns) pulses 一个例子的如何这些信号是联合的是显示在这下列的 diagram TLF11157–6 这信号和前-emphasis 显示在之上是发生用 resistively 结合 TXO 一个和 TXOd b  这个信号 along 和它的 complement 是 passed 至这 transmit filter 状态信息状态信息是提供用这 st-nic 在这 CRSRX TXETX COL 和 POL 输出作描述在这管脚描述 table 这些输出是合适的为 driv- ing 状态 LEDs 通过一个适合的驱动器 circuit 这 POL 输出是正常情况下 low 和将是驱动高当七 consecutive link 脉冲或者三 consecutive receive packets 是发现和使反转 polarity 一个 polar- ity 倒置能是造成用一个线路错误在也终止的这 TPI cable 在发现的一个极性倒置这 condi- tion 是 latched 和 POL 是 asserted 这 TPI corrects 为这个错误内部和将 decode received 数据 correctly elim- inating 这需要至准确无误的这线路 error ENCODERDECODER (endec) 单元这 ENDEC 组成的三主要的 logical blocks 一个) 这 Manchester encoder accepts NRZ 数据从这 controller encodes 这数据至 Manchester 和 trans- mits 它 differentially 至这 transceiver 通过这 differ- ential transmit driver b) 这 Manchester 解码器 receives Manchester 数据从这 transceiver converts 它至 NRZ 数据和时钟 pulses 和发送它至这 controller c) 这 collision 翻译 indicates 至这控制这存在的一个有效的 10 MHz collision 信号至这 PLL MANCHESTER ENCODER 和差别的驱动器这差别的 transmit pair 在这 secondary 的这 trans- former 驱动向上至 50 计量表的 twisted 一双 AUI cable 这些输出是源 followers 这个需要二 270 X 拉-向下电阻器至 ground 这 DP83902A 准许两个都 half-步伐和全部-步伐至是兼容和 Ethernet 和 IEEE 8023 和这 SEL 管脚低 (为 Ethernet i) Transmit 一个是积极的和遵守至 Transmit b 在 idle 和 SEL 高 (为 IEEE 8023) Transmit 一个和 Transmit b 是 equal 在这空闲 state 这个提供零差别的电压至运作和 transform- er 结合 loads MANCHESTER 解码器这解码器组成的一个差别的接受者和一个 PLL 至独立的一个 Manchester 解码数据 stream 在内部的时钟信号和 data 这差别的输入必须是 exter- nally terminated 和二 39 X 电阻器连接在序列如果这标准 78 X transceiver 漏出缆索是 used 在薄的 Ethernet applications 这些电阻器是 optional 至前- vent 噪音从 falsely triggering 这 decoder 一个 squelch 电路在这输入 rejects 信号和水平较少比 b 175 mV 信号更多负的比 b 300 mV 是 de- coded 数据变为有效的典型地在里面 5 位 times 这 DP83902A 将 tolerate 位 jitter 向上至 18 ns 在这 received data 这解码器发现这终止的一个框架当非更多 mid-位 transitions 是 detected COLLISION 翻译当在 AUI mode 当这 Ethernet transceiver (dp8392 cti) 发现一个 collision 它发生一个 10 MHz 信号至这差别的 collision 输入 (cd g ) 的这 DP83902A 当这些输入是发现 active 这 DP83902A 使用这个信号至后面的止它的电流传递和 reschedule 另一 one 这 collision 差别的输入是 terminated 这一样方法作这差别的 receive inputs 这 squelch 电路系统是也 similar rejecting 脉冲和水平较少比 b 175 mV CRYSTALOSCILLATOR 运作 OCSILLATOR 这振荡器是控制用一个 20 MHz 并行的 resonant 结晶连接在 X1 和 X2 或者用一个外部时钟在 X1 这 20 MHz 输出的这振荡器是分隔用 2 至发生这 10 MHz transmit 时钟为这控制- ler 这振荡器也提供内部的时钟信号至这 encoding 和解码 circuits Note 当 X1 是正在驱动用一个外部 oscillator X2 必须是 grounded 结晶规格 Resonant 频率 20 MHz 容忍 g 0005% 在 25  C 稳固 g 0005% 在 0  C–70  C 类型在截电路并行的 Resonance 最大值等效串联电阻 25 X 结晶加载电容 20 pF 这 20 MHz 结晶连接至这 DP83902 需要特定的 care 这 IEEE 8023 标准需要这 trans- mitted 信号频率至是精确在里面 g 001% 偏离电容能变换这 crystal’s 频率输出的范围和导致 transmitted 频率至超过它的 001% tolerance 这频率 marked 在这结晶是通常地量过的和一个 fixed 加载电容指定在这 crystal’s 数据 sheet 典型地 20 pF 10

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