DP83902AV_集成电路资料查询网

连接 图解
(持续)
TLF11157–65
顺序 号码 DP83902AVJG
看 NS 包装 号码 VJG100A
20 管脚 描述
PQFP PLCC AVJG 管脚
IO 描述
管脚 No 管脚 No 管脚 No 名字
总线 接口 管脚
95 5 92 INT O
INTERRUPT
Indicates 那 这 DP83902A 需要 CPU 注意 之后
reception 传递 或者 completion 的 DMA transfers 这 中断 是 cleared
用 writing 至 这 ISR (中断 状态 寄存器) 所有 中断 是 maskable
96 6 93 WACK I
写 ACKNOWLEDGE
Issued 从 系统 至 DP83902A 至 表明 那
数据 有 被 写 至 这 外部 latch 这 DP83902A 将 begin 一个 写
循环 至 放置 这 数据 在 local memory
98 7 95 PRD O
端口 READ
使能 数据 从 外部 获得 在 至 local 总线 在 一个
记忆 写 循环 至 local 记忆 (偏远的 写 运作) 这个 准许
异步的 转移 的 数据 从 这 系统 记忆 至 local memory
99 100 8–11 96 RA3–RA0 I
寄存器 ADDRESS
这些 四 管脚 是 使用 至 选择 一个 寄存器 至 是 读
1 2 98–100 或者 written 这 状态 的 这些 输入 是 ignored 当 这 DP83902A 是 不 在
从动装置 模式 (cs
高)
4

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连接图解 (持续) TLF11157–65 顺序号码 DP83902AVJG 看 NS 包装号码 VJG100A 20 管脚描述 PQFP PLCC AVJG 管脚 IO 描述管脚 No 管脚 No 管脚 No 名字总线接口管脚 95 5 92 INT O INTERRUPT Indicates 那这 DP83902A 需要 CPU 注意之后 reception 传递或者 completion 的 DMA transfers 这中断是 cleared 用 writing 至这 ISR (中断状态寄存器) 所有中断是 maskable 96 6 93 WACK I 写 ACKNOWLEDGE Issued 从系统至 DP83902A 至表明那数据有被写至这外部 latch 这 DP83902A 将 begin 一个写循环至放置这数据在 local memory 98 7 95 PRD O 端口 READ 使能数据从外部获得在至 local 总线在一个记忆写循环至 local 记忆 (偏远的写运作) 这个准许异步的转移的数据从这系统记忆至 local memory 99 100 8–11 96 RA3–RA0 I 寄存器 ADDRESS 这些四管脚是使用至选择一个寄存器至是读 1 2 98–100 或者 written 这状态的这些输入是 ignored 当这 DP83902A 是不在从动装置模式 (cs 高) 4

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