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资料编号:267912
 
资料名称:DS89C450-MNL
 
文件大小: 656.43K
   
说明
 
介绍:
Ultra-High-Speed Flash Microcontrollers
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
ds89c430/ds89c440/ds89c450
7 的 48
便条 15:
这 时钟 分隔 和 结晶 乘法器 控制 位 在 这 pmr 寄存器 决定 这 系统 时钟 频率 和 这 最小/
最大 外部 时钟 速. 这 期 “1/t
CLCL
” 使用 在 这
交流 特性
能变的 定时 表格 是 决定 从 这
下列的 表格. 这 最小/最大 外部 时钟 速 columns clarify 那 [(外部 时钟 速) x (multipliers)] 不能
超过 这 评估 速 的 这 设备. 在 增加, 这 使用 的 这 结晶 乘法器 特性 establishes 一个 最小 外部 speed.
外部 时钟 速
4x/
2X
cd1 cd0
号码 的 外部 时钟
循环 每 系统 时钟
(1/t
CLCL
)
最小值 最大值
1 0 0 1/4 5MHz 8.25mhz
0 0 0 1/2 10MHz 16.5mhz
x 0 1 保留
X 1 0 1 看 交流 特性
看 交流 特性
X 1 1 1024 看 交流 特性
看 交流 特性
便条 16:
外部 movx 操作指南 时间 是 依赖 在之上 这 设置 的 这 md2, md1, 和 md0 位 在 这 时钟 控制 寄存器. 这
条款 “t
STC1
, t
STC2
, t
STC3
” 使用 在 这 能变的 定时 表格 在之上 是 计算 通过 这 使用 的 这 表格 给 在下.
md2 md1 MD0 movx 操作指南 时间 t
STC1
t
STC2
t
STC3
t
STC4
t
STC5
0 0 0 2 机器 循环 0 t
CLCL
0 t
CLCL
0 t
CLCL
0 t
CLCL
0 t
CLCL
0 0 1 3 机器 循环 2 t
CLCL
1 t
CLCL
0 t
CLCL
0 t
CLCL
1 t
CLCL
0 1 0 4 机器 循环 6 t
CLCL
1 t
CLCL
0 t
CLCL
0 t
CLCL
1 t
CLCL
0 1 1 5 机器 循环 10 t
CLCL
1 t
CLCL
0 t
CLCL
0 t
CLCL
1 t
CLCL
1 0 0 6 机器 循环 14 t
CLCL
5 t
CLCL
4 t
CLCL
1 t
CLCL
1 t
CLCL
1 0 1 7 机器 循环 18 t
CLCL
5 t
CLCL
4 t
CLCL
1 t
CLCL
1 t
CLCL
1 1 0 8 机器 循环 22 t
CLCL
5 t
CLCL
4 t
CLCL
1 t
CLCL
1 t
CLCL
1 1 1 9 机器 循环 26 t
CLCL
5 t
CLCL
4 t
CLCL
1 t
CLCL
1 t
CLCL
便条 17:
最大 加载 电容 (至 满足 这 在之上 定时) 为 端口 0, ale,
PSEN
,
wr,
RD
是 限制 至 60pf. xtal1 和 xtal2 加载
电容 是 依赖 在之上 这 频率 的 这 选择 结晶.
图示 1. nonpage 模式 定时
ALE
端口 0
端口 2
LSB
数据
XTAL1
PSEN
RD
MSB MSBMSBMSB
MSB
WR
LSBLSB
LSB LSB
数据
MOVX
MOVX
OPCODE
t
CLCL
t
AVLL2
t
LHLL
t
WLWH
t
LLAX2
t
LLWL
t
LLPL
t
LLAX
t
LLIV
t
AVIV0
t
PXIX
t
PLPH
t
PLIV
t
AVLL3
t
LLAX3
t
RLRH
t
PLAZ
t
WHLH
t
WHQX
t
QVWX
t
AVIV2
t
AVDV2
t
AVWL2
t
PXIZ
t
AVLL
t
LLDV
t
AVDV0
t
RHDX
t
RHDZ
t
RLDV
t
AVWL0
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