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资料编号:268186
 
资料名称:DS92LV16TVHG
 
文件大小: 397.08K
   
说明
 
介绍:
16-Bit Bus LVDS Serializer/Deserializer - 25 - 80 MHz
 
 


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Deserializer 切换 特性
(持续)
推荐 运行 供应 温度 范围 除非 否则 指定.
标识 参数 情况 管脚/freq. 最小值 典型值 最大值 单位
t
DSR1
Deserializer PLL
时间
PWRDWN (和
syncpat)
(便条 7)
35MHz 3.7 10 µs
80 MHz 1.9 4 µs
t
DSR2
Deserializer PLL
时间
SYNCPAT
35MHz 1.5 5 µs
80 MHz 0.9 2 µs
t
rnmi-r
完美的 Deserializer
噪音 余裕 正确的
图示 16
(便条 6)
35 MHz +630 ps
80 MHz +230 ps
t
rnmi-l
完美的 Deserializer
噪音 余裕 Left
图示 16
(便条 6)
35 MHz −630 ps
80 MHz −230 ps
便条 1:
“Absolute 最大 Ratings” 那些 在之外 这个 安全 设备 不能 有保证的. 它们 meant imply 设备
应当 运作 这些 限制. 表格 “Electrical Characteristics” specifies 情况 设备 运作.
便条 2:
典型 V
CC
= 3.3v T
一个
= +25˚c.
便条 3:
电流 设备 管脚 定义 积极的. 电流 输出 设备 管脚 定义 负的. 电压 关联 地面 除了 vod,
vod,
VTH VTL 这个 差别的 电压.
便条 4:
预定的 触发-状态 serializer, Deserializer lose PLL resynchronize 在之前 数据 转移.
便条 5:
目的 specifying deserializer PLL 效能 tDSR1 tDSR2 指定 REFCLK 运动 稳固的, 明确的 情况
新当选的 数据 stream (syncpats). 推荐 derserializer initialized 使用 tDSR1 定时 或者 tDSR2 定时. tDSR1 时间
必需的 deserializer 表明 在之上 电源-向上 或者 leaving 电源-向下 模式. 同步 patterns 应当 sent 设备 在之前
初始的 情况. tDSR2 时间 必需的 表明 powered-向上 使能 deserializer 输入 (ri+ ri-) 情况 改变
接到 数据 接到 同步 patterns (syncpats).
便条 6:
tRNMI 一个 measure 如何 阶段 噪音 (jitter) deserializer tolerate 新当选的 数据 stream 在之前 errors 出现. 一个 度量
涉及 完美的 位置, National’s 一个-1217 detail.
便条 7:
同步 模式 一个 fixed 模式 8-位 数据 followed 8-位 数据 低.
DS92LV16
www.国家的.com5
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