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资料编号:398784
 
资料名称:ICS270PGILF
 
文件大小: 162.29K
   
说明
 
介绍:
Triple PLL Field Programmable VCXO Clock Synthesizer
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
triple pll 地方 可编程序的 vcxo 时钟
mds 270 b
6
修订 040705
整体的 电路 系统, 公司
525 race 街道, san jose, ca 95126
电话 (408) 297-1201
www.icst.com
ICS270
初步的 信息
便条 1: 例子 和 25 mhz 结晶 输入 和 第八 输出 的 33.3mhz, 非 加载, 和 vdd = 3.3 v.
交流 电的 特性
除非 陈述 否则,
vdd = 3.3 v ±5%
, 包围的 温度 -40 至 +85
°
C
便条 1: 外部 结晶 设备 必须 遵从 和 pullable 结晶 规格 列表 在 页 3.
便条 2: 量过的 和 15 pf 加载.
便条 3: 职责 循环 是 配置 依赖. 大多数 配置 是 最小值 45% / 最大值 55%.
热的 特性
内部的 拉-向上 电阻 R
PUS
s2:s0, pdts 190 k
内部的 拉-向下 电阻 R
PD
clk 输出 220 k
输入 电容 C
输入 4 pF
参数 标识 情况 最小值 典型值 最大值 单位
输入 频率 F
基本的 结晶 5 27 MHz
输出 频率 0.314 200 MHz
结晶 pullability F
P
0v<vin <3.3 v, 便条 1 100 ppm
vcxo 增益 vin = vdd/2 +
1 v,
便条 1
110 ppm/v
输出 上升/下降 时间 t
80% 至 20%, 高 驱动,
便条 2
1.0 ns
输出 上升/下降 时间 t
80% 至 20%, 低 驱动,
便条 2
2.0 ns
职责 循环 便条 3 40 49-51 60 %
电源-向上 时间
pll 锁-时间 从
电源-向上
410ms
PDTS
变得 高 直到
稳固的 clk 输出
0.6 2 ms
一个 sigma 时钟 时期 jitter 配置 依赖 50 ps
最大 绝对 jitter t
ja
背离 从 意思,
配置 依赖
+200 ps
管脚-至-管脚 skew 低 skew 输出 -250 250 ps
参数 标识 情况 最小值 典型值 最大值 单位
热的 阻抗 接合面 至
包围的
θ
JA
安静的 空气 93
°
c/w
θ
JA
1 m/s 空气 流动 78
°
c/w
θ
JA
3 m/s 空气 流动 65
°
c/w
热的 阻抗 接合面 至 情况
θ
JC
20
°
c/w
参数 标识 情况 最小值 典型值 最大值 单位
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