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资料编号:656554
 
资料名称:TP11362AV
 
文件大小: 442.32K
   
说明
 
介绍:
Quad Adaptive Differential PCM Processor
 
 


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定时 规格
(持续)
除非 否则 指出, 限制 打印
bold
characters 有保证的 V
CC
=
5.0v
±
5
%
, GND1
=
GND2
=
0v, T
一个
=
−40˚C +85˚C correlation 100
%
电的 测试 T
一个
=
25˚c. 所有 其它 限制 使确信 correlation 其它
生产 tests 和/或者 产品 设计 描绘. 典型 指定 V
CC
=
+5v, T
一个
=
25˚c.
标识 参数 情况 最小值 典型值 最大值 单位
t
HDCEL
支撑 时间, CE 之后 CE 15 ns
psck/asck
t
SUCEH
建制 时间, CE 在之前 CE 15 ns
psck/asck
t
TRBH
TRB 支撑 时间 CE
20
ns
t
TRBS
TRB 建制 时间 ASCK PSCK
20
ns
t
tsi, RSI 建制 时间 ASCK PSCK
20
ns
t
IH
tsi, RSI 支撑 时间 ASCK PSCK
20
ns
t
psck/asck
psck/asck 55 ns
时间
t
tso, RSO 转变 时间 CE
40
ns
t
OD
tso, RSO 传播 ASCK 或者 PSCK
40
ns
延迟 时间
t
tso, RSO 转变 时间 CE
20
ns
(有效的 数据 触发-状态)
t
CS
建制 时间 控制 CE
信号 (init, en,
20
ns
pcm1, qsel1, qsel0)
t
CH
支撑 时间 控制 CE
信号 (init, en,
20
ns
pcm1, qsel1, qsel0)
t
RSTL
RSTB 脉冲波 宽度 2 CLK
循环
t
RSTH
RSTB 第一 6 CLK
CE 高-低 转变 循环
便条 5:
4 全部-duplex (解码 encoding) 或者 8 half-duplex (解码 或者 encoding) 途径 运作 一个 125 µs 时期.
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