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资料编号:688928
 
资料名称:TMS320VC5410PGE
 
文件大小: 1170.53K
   
说明
 
介绍:
FIXED-POINT DIGITAL SIGNAL PROCESSOR
 
 


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   
sprs075d – october 1998 – 修订 将 2000
8
邮递 办公室 盒 1443
houston, 德州 77251–1443
终端 功能 (持续)
终端
名字
descriptioni/o
终端
名字
descriptioni/o
记忆 控制 信号 (持续)
IAQ o/z
操作指南 acquisition 信号. iaq是 asserted (起作用的 低) 当 那里 是 一个 操作指南 地址 在 这 地址
总线 和 变得 在 这 高-阻抗 状态 当 止
是 低.
振荡器/计时器 信号
CLKOUT o/z
时钟 输出 信号. clkout 能 代表 这 机器-循环 比率 的 这 cpu 分隔 用 1, 2, 3, 或者 4 作
配置 在 这 bank-切换 控制 寄存器 (bscr). 下列的 重置, clkout 代表 这
机器-循环 比率 分隔 用 4.
CLKMD1
CLKMD2
CLKMD3
I
时钟模式 选择 信号. clkmd1 – clkmd3 准许 这 选择 和 配置 的 不同的 时钟 模式
此类 作 结晶, 外部 时钟, pll 模式.
x2/clkin I 时钟/振荡器 输入. 如果 这 内部的 振荡器 是 不 正在 使用, x2/clkin 功能 作 这 时钟 input.
X1 O
输出 管脚 从 这 内部的 振荡器 为 这 结晶. 如果 这 内部的 振荡器 是 不 使用, x1 应当 是 left
unconnected. x1 做 不 go 在 这 高-阻抗 状态 当 止
是 低.
TOUT O
计时器 输出. tout 信号 一个 脉冲波 当 这 在-碎片 计时器 counts 向下 past 零. 这 脉冲波 是 一个 clkout
循环 宽. tout 也 变得 在 这 高-阻抗 状态 当 止
是 低.
multichannel 缓冲 串行 端口 0 (mcbsp #0), multichannel 缓冲 串行 端口 1 (mcbsp #1),
和 multichannel 缓冲 串行 端口 2 (mcbsp #2) 信号
BCLKR0
BCLKR1
BCLKR2
i/o/z receive 时钟 输入. bclkr serves 作 这 串行 变换 时钟 为 这 缓冲 串行 端口 接受者.
BDR0
BDR1
BDR2
I 串行 数据 receive 输入
BFSR0
BFSR1
BFSR2
i/o/z 框架 同步 脉冲波 为 receive 输入. 这 bfsr 脉冲波 initiates 这 receive 数据 处理 在 bdr.
BCLKX0
BCLKX1
BCLKX2
i/o/z
transmit 时钟. bclkx serves 作 这 串行 变换 时钟 为 这 mcbsp 传输者.bclkx 能 是 配置 作
一个 输入 或者 一个 输出, 和 是 配置 作 一个 输入 下列的 重置. bclkx enters 这 高-阻抗 状态 当
变得 低.
BDX0
BDX1
BDX2
o/z
串行 数据 transmit 输出. bdx 是 放置 在 这 高-阻抗 状态 当 不 transmitting, 当 rs
asserted, 或者 当 止
是 低.
BFSX0
BFSX1
BFSX2
i/o/z
框架 同步 脉冲波 为 transmit 输入/输出. 这 bfsx 脉冲波 initiates 这 数据 transmit 处理 在
bdx.bfsx 能 是 配置 作 一个 输入 或者 一个 输出, 和 是 配置 作 一个 输入 下列的 重置. bfsx 变得
在 这 高-阻抗 状态 当 止
是 低.
BCLKS0
BCLKS1
BCLKS2
I
串行 端口 时钟 涉及. 这 mcbsp 能 是 编写程序 至 使用 也 bclks 或者 这 cpu 时钟 作 一个
涉及 为 一代 的 内部的 时钟 和 框架 同步 信号. 管脚 和 内部的 pullup 设备.
便条: 这些 管脚 是 不 有 在 这 pge 包装.
miscellaneous 信号
NC 非 连接
host-端口 接口 信号
HD0–HD7 i/o/z
并行的 双向的 数据 总线. hd0–hd7 是 放置 在 这 高-阻抗 状态 当 不 outputting 数据. 这
信号 go 在 这 高-阻抗 状态 当 止
是 低. 这 hpi 数据 总线 有 一个 特性 called 一个 总线 holder
排除 被动的 组件 和 这 电源 消耗 有关联的 和 它们. 这 总线 holder keeps 这
数据 总线 在 这 previous 逻辑 水平的 当 这 总线 变得 在 高-阻抗 状态. 这 总线 holder 在 这 hpi
数据 总线 能 是 使能/无能 下面 软件 控制.
i = 输入, o = 输出, z = 高-阻抗, s = 供应
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