IS41C16100
IS41LV16100
整体的 硅 解决方案, 公司 — www.issi.com —
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9
rev. I
04/16/03
ISSI
®
注释:
1. 一个 最初的 pause 的 200 µs 是 必需的 之后 电源-向上 followed 用 第八
RAS
refresh 循环 (
RAS
-仅有的 或者 cbr) 在之前 恰当的 设备
运作 是 使确信. 这 第八
RAS
循环 wake-向上 应当 是 重复的 任何 时间 这 t
REF
refresh 必要条件 是 超过.
2. V
IH
(最小值) 和 v
IL
(最大值) 是 涉及 水平 为 测量 定时 的 输入 信号. 转变 时间, 是 量过的 在 v
IH
和
V
IL
(或者 在 v
IL
和 v
IH
) 和 假设 至 是 1 ns 为 所有 输入.
3. 在 增加 至 meeting 这 转变 比率 规格, 所有 输入 信号 必须 transit 在 v
IH
和 v
IL
(或者 在 v
IL
和 v
IH
) 在 一个
monotonic manner.
4. 如果
CAS
和
RAS
= v
IH
, 数据 输出 是 高-z.
5. 如果
CAS
= v
IL
, 数据 输出 将 包含 数据 从 这 last 有效的 读 循环.
6. 量过的 和 一个 加载 相等的 至 一个 ttl 门 和 50 pf.
7. 假设 那 t
RCD
- t
RCD
(最大值). 如果 t
RCD
是 更好 比 这 最大 推荐 值 显示 在 这个 表格, t
RAC
将 增加 用 这
数量 那 t
RCD
超过 这 值 显示.
8. 假设 那 t
RCD
• t
RCD
(最大值).
9. 如果
CAS
是 低 在 这 下落 边缘 的
RAS
, 数据 输出 将 是 maintained 从 这 previous 循环. 至 initiate 一个 新 循环 和 clear 这 数据
输出 缓存区,
CAS
和
RAS
必须 是 搏动 为 t
CP
.
10. 运作 和 这 t
RCD
(最大值) 限制 确保 那 t
RAC
(最大值) 能 是 符合. t
RCD
(最大值) 是 指定 作 一个 涉及 要点 仅有的; 如果 t
RCD
是
更好 比 这 指定 t
RCD
(最大值) 限制, 进入 时间 是 控制 exclusively 用 t
CAC
.
11. 运作 在里面 这 t
RAD
(最大值) 限制 确保 那 t
RCD
(最大值) 能 是 符合. t
RAD
(最大值) 是 指定 作 一个 涉及 要点 仅有的; 如果 t
RAD
是
更好 比 这 指定 t
RAD
(最大值) 限制, 进入 时间 是 控制 exclusively 用 t
AA
.
12. 也 t
RCH
或者 t
RRH
必须 是 satisfied 为 一个 读 循环.
13. t
止
(最大值) 定义 这 时间 在 这个 这 输出 achieves 这 打开 电路 情况; 它 是 不 一个 涉及 至 v
OH
或者 v
OL
.
14. t
WCS
, t
RWD
, t
AWD
和 t
CWD
是 restrictive 运行 参数 在 late 写 和 读-modify-写 循环 仅有的. 如果 t
WCS
• t
WCS
(最小值), 这 循环 是 一个 early 写 循环 和 这 数据 输出 将 仍然是 打开 电路 全部地 这 全部 循环. 如果 t
RWD
• t
RWD
(最小值),
t
AWD
• t
AWD
(最小值) 和 t
CWD
• t
CWD
(最小值), 这 循环 是 一个 读-写 循环 和 这 数据 输出 将 包含 数据 读 从 这 选择
cell. 如果 neither 的 这 在之上 情况 是 符合, 这 状态 的 i/o (在 进入 时间 和 直到
CAS
和
RAS
或者
OE
go 后面的 至 v
IH
) 是
indeterminate.
OE
使保持 高 和
我们
带去 低 之后
CAS
变得 低 结果 在 一个 late 写 (
OE
-控制) 循环.
15. 输出 参数 (i/o) 是 关联 至 相应的
CAS
输入, i/o0-i/o7 用
LCAS
和 i/o8-i/o15 用
UCAS
.
16. 在 一个 读 循环, 如果
OE
是 低 然后 带去 高 在之前
CAS
变得 高, i/o 变得 打开. 如果
OE
是 系 permanently 低, 一个 late
写 或者 读-modify-写 是 不 可能.
17. 写 command 是 定义 作
我们
going 低.
18. late 写 和 读-modify-写 循环 必须 有 两个都 t
OD
和 t
OEH
符合 (
OE
高 在 写 循环) 在 顺序 至 确保
那 这 输出 缓存区 将 是 打开 在 这 写 循环. 这 i/os 将 提供 这 先前 写 数据 如果
CAS
仍然是 低 和
OE
是 带去 后面的 至 低 之后 t
OEH
是 符合.
19. 这 i/os 是 在 打开 在 读 循环 once t
OD
或者 t
止
出现.
20. 这 第一
χ
CAS
边缘 至 转变 低.
21. 这 last
χ
CAS
边缘 至 转变 高.
22. 这些 参数 是 关联 至
CAS
leading 边缘 在 early 写 循环 和
我们
leading 边缘 在 late 写 或者 读-
modify-写 循环.
23. last 下落
χ
CAS
边缘 至 第一 rising
χ
CAS
边缘.
24. last rising
χ
CAS
边缘 至 next 循环’s last rising
χ
CAS
边缘.
25. last rising
χ
CAS
边缘 至 第一 下落
χ
CAS
边缘.
26. 各自
χ
CAS
必须 满足 最小 脉冲波 宽度.
27. Last
χ
CAS
至 go 低.
28. i/os 控制, regardless
UCAS
和
LCAS
.
29. 这 3 ns 最小 是 一个 参数 有保证的 用 设计.
30. 使能 在-碎片 refresh 和 地址 counters.
交流 测试 情况
输出 加载: 二 ttl 负载 和 50 pf (vcc = 5.0v ±10%)
一个 ttl 加载 和 50 pf (vcc = 3.3v ±10%)
输入 定时 涉及 水平: V
IH
= 2.4v, v
IL
= 0.8v (vcc = 5.0v ±10%);
V
IH
= 2.0v, v
IL
= 0.8v (vcc = 3.3v ±10%)
输出 定时 涉及 水平: V
OH
= 2.0v, v
OL
= 0.8v (vcc = 5v ±10%, 3.3v ±10%)
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