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资料编号:831148
 
资料名称:ICS601M-01
 
文件大小: 88K
   
说明
 
介绍:
Low Phase Noise Clock Multiplier
 
 


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ics601-01
低 阶段 噪音 时钟 乘法器
mds 601-01 g
1 修订 090800 打印 11/14/00
整体的 电路 系统, 公司 • 525 race 街道 • san jose •ca•95126• (408) 295-9800tel • www.icst.com
这 ics601-01 是 一个 低 费用, 低 阶段 噪音, 高
效能 时钟 synthesizer 为 任何 产品
那 需要 低 阶段 噪音 和 低 jitter. 它 是
ics’ 最低 阶段 噪音 乘法器, 和 也 这
最低 cmos 部分 在 这 工业. 使用 ics’
专利的 相似物 和 数字的 阶段 锁 循环
(pll) 技巧, 这 碎片 accepts 一个 10-27 mhz
结晶 或者 时钟 输入, 和 生产 输出 clocks
向上 至 156 mhz 在 3.3 v.
块 图解
描述
特性
• packaged 在 16 管脚 soic 或者 tssop
• 使用 基本的 10 - 27 mhz 结晶, 或者 时钟
• 专利的 pll 和 这 最低 阶段 噪音
• 输出 clocks 向上 至 156 mhz 在 3.3 v
• 低 阶段 噪音: -132 dbc/hz 在 10 khz
• 输出 使能 函数 触发 states 输出
• 低 jitter - 18 ps 一个 sigma
• 全部 摆动 cmos 输出 和 25 毫安 驱动
能力 在 ttl 水平
• 先进的, 低 电源, sub-micron cmos 处理
• 工业的 温度 版本 有
• 3.3 v 或者 5 v 运作
涉及
分隔
阶段
比较器
结晶
振荡器
只读存储器 为基础
Multipliers
VCO
分隔
承担
打气
循环
过滤
VCO
输出
缓存区
x1/iclk
X2
S0S1
VDD
OE
CLK
输出
缓存区
REFOUT
REFEN
S3 S2
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