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资料编号:965513
 
资料名称:ADSP-2115KS-66
 
文件大小: 668K
   
说明
 
介绍:
ADSP-2100 Family DSP Microcomputers
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
adsp-21xx
rev. b
–5–
图示 1. adsp-21xx 块 图解
一个 总线 grant 执行 模式 (go 模式) 准许 这 adsp-
21xx 至 continue 运动 从 内部的 记忆. 一个 第二
执行 模式 需要 这 处理器 至 halt 当 buses 是
准予.
各自 adsp-21xx 处理器 能 respond 至 一些 不同的
中断. 那里 能 是 向上 至 三 外部 中断,
配置 作 边缘- 或者 水平的-敏感的. 内部的 中断 能 是
发生 用 这 计时器, 串行 端口, 和, 在 这 adsp-2111,
这 host 接口 端口. 那里 是 也 一个 主控
重置
信号.
booting 电路系统 提供 为 加载 在-碎片 程序 记忆
automatically 从 字节-宽 外部 记忆. 之后 重置,
三 wait states 是 automatically 发生. 这个 准许, 为
例子, 一个 60 ns adsp-2101 至 使用 一个 200 ns 非易失存储器 作
外部 激励 记忆. 多样的 programs 能 是 选择 和
承载 从 这 非易失存储器 和 非 额外的 硬件.
这 数据 receive 和 transmit 管脚 在 sport1 (串行 端口 1)
能 是 alternatively 配置 作 一个 一般-目的 输入 标记
和 输出 标记. 你 能 使用 这些 管脚 为 事件 signalling 至
和 从 一个 外部 设备. 这 adsp-2111 有 三
额外的 标记 输出 谁的 states 是 控制 通过
软件.
一个 可编程序的 间隔 计时器 能 发生 periodic 中断.
一个 16-位 计数 寄存器 (tcount) 是 decremented 每
n
循环, 在哪里
n–1
是 一个 范围调整 值 贮存 在 一个 8-位 寄存器
(tscale). 当 这 值 的 这 计数 寄存器 reaches 零,
一个 中断 是 发生 和 这 计数 寄存器 是 reloaded 从
一个 16-位 时期 寄存器 (tperiod).
串行 端口
这 adsp-21xx processors 包含 二 同步的 串行
端口 (“sports”) 为 串行 communications 和 multiproces-
sor 交流. 所有 的 这 adsp-21xx processors 有 二
串行 端口 (sport0, sport1) 除了 为 这 adsp-2105,
这个 有 仅有的 sport1.
这 串行 端口 提供 一个 完全 同步的 串行 接口
和 optional companding 在 硬件. 一个 宽 多样性 的
framed 或者 frameless 数据 transmit 和 receive 模式 的 opera-
tion 是 有. 各自 sport 能 发生 一个 内部的
可编程序的 串行 时钟 或者 接受 一个 外部 串行 时钟.
各自 串行 端口 有 一个 5-管脚 接口 consisting 的 这 下列的
信号:
信号 名字 函数
SCLK 串行 时钟 (i/o)
RFS receive 框架 同步 (i/o)
TFS transmit 框架 同步 (i/o)
DR 串行 数据 receive
DT 串行 数据 transmit
这 adsp-21xx 串行 端口 提供 这 下列的 能力:
双向的
—each sport 有 一个 独立的, 翻倍-缓冲
transmit 和 receive 函数.
有伸缩性的 clocking
—each sport 能 使用 一个 外部 串行
时钟 或者 发生 它的 自己的 时钟 内部.
r 总线
16
dmd 总线
HOST
端口
控制
pmd 总线
dma 总线
pma 总线
14
24
16
外部
地址
总线
外部
数据
总线
HOST
端口
数据
激励
地址
发生器
计时器
14
11
总线
EXCHANGE
COMPANDING
电路系统
5
1624
receive reg
transmit reg
串行
端口 1
外部
host 端口
总线
dma 总线
pma 总线
dmd 总线
pmd 总线
host 接口 端口
(adsp-2111 仅有的)
FLAGS
(adsp-2111 仅有的)
3
程序
SEQUENCER
操作指南
寄存器
程序
记忆
SRAM
或者 只读存储器
数据
记忆
SRAM
数据
地址
发生器
#2
数据
地址
发生器
#1
14
输入 regs
输出 regs
SHIFTER
输入 regs
输出 regs
MAC
输入 regs
输出 regs
ALU
receive reg
transmit reg
串行
端口 0
(不 在 adsp-2105)
5
16
MUX
24
MUX
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