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资料编号:974027
 
资料名称:CY7C057V-15AI
 
文件大小: 459K
   
说明
 
介绍:
3.3V 16K/32K x 36 FLEx36 Asynchronous Dual-Port Static RAM
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
CY7C056V
CY7C057V
8
初步的
切换 特性
在 这 运行 范围
[13]
参数 描述
CY7C056V
CY7C057V
单位
-10 -12
-15 -20
最小值 最大值 最小值 最大值
最小值 最大值 最小值 最大值
读 循环
t
RC
读 循环 时间 10 12 15 20 ns
t
AA
地址 至 数据 有效的 10 12 15 20 ns
t
OHA
输出 支撑 从 地址
改变
333 3 ns
t
ACE
[3, 14]
CE低 至 数据 有效的 10 12 15 20 ns
t
DOE
OE低 至 数据 有效的 6 8 10 12 ns
t
LZOE
[3, 15, 16, 17]
OE低 至 低 z 0 0 0 0 ns
t
HZOE
[3, 15, 16, 17]
OE高 至 高 z 8 10 10 12 ns
t
LZCE
[3, 13, 16, 17]
CE低 至 低 z 3 3 3 3 ns
t
HZCE
[3, 15, 16, 17]
CE高 至 高 z 8 10 10 12 ns
t
LZBE
字节 使能 至 低 z 3 3 3 3 ns
t
HZBE
字节 使能 至 高 z 8 10 10 12 ns
t
PU
[3, 17]
CE低 至 电源-向上 0 0 0 0 ns
t
PD
[3, 17]
CE高 至 电源-向下 10 12 15 20 ns
t
ABE
[14]
字节 使能 进入 时间 10 12 15 20 ns
写 循环
t
WC
写 循环 时间 10 12 15 20 ns
t
SCE
[3, 14]
CE低 至 写 终止 7.5 10 12 15 ns
t
AW
地址 有效的 至 写 终止 7.5 10 12 15 ns
t
HA
地址 支撑 从 写
终止
000 0 ns
t
SA
[14]
地址 设置-向上 至 写
开始
000 0 ns
t
PWE
写 脉冲波 宽度 7.5 10 12 15 ns
t
SD
数据 设置-向上 至 写 终止 7.5 10 10 15 ns
t
HD
数据 支撑 从 写 终止 0 0 0 0 ns
t
HZWE
[16, 17]
r/w低 至 高 z 8 10 10 12 ns
t
LZWE
[16, 17]
r/w高 至 低 z 3 3 3 3 ns
t
WDD
[18]
写 脉冲波 至 数据 延迟 20 25 30 45 ns
t
DDD
[18]
写 数据 有效的 至 读
数据 有效的
16 20 25 30 ns
busy 定时
[19]
t
BLA
BUSY低 从 地址
相一致
10 12 15 20 ns
t
BHA
BUSY高 从 地址
Mismatch
10 12 15 20 ns
t
BLC
BUSY低 从 ce 10 12 15 20 ns
注释:
13. 测试 情况 假设 信号 转变 时间 的 3 ns 或者 较少, 定时 涉及 水平 的 1.5v, 输入 脉冲波 水平 的 0 至 3.0v, 和 输出 加载 的 这 指定
I
OI
/i
OH
和 10-pf 加载 电容.
14. 至 进入 内存, ce
= l 和 sem= h. 至 进入 semaphore, ce= h 和 sem= l. 也 情况 必须 是 有效的 为 这 全部 t
SCE
时间.
15. 在 任何 给 温度 和 电压 情况 为 任何 给 设备, t
HZCE
是 较少 比 t
LZCE
和 t
HZOE
是 较少 比 t
LZOE
.
16. 测试 情况 使用 是 加载 2.
17. 这个 参数 是 有保证的 用 设计, 但是 它 是 不 生产 测试. 为 信息 在 端口-至-端口 延迟 通过 内存 cells 从 writing 端口 至 读
端口, 谈及 至 读 定时 和 busy 波形.
18. 为 信息 在 端口-至-端口 延迟 通过 内存 cells 从 writing 端口 至 读 端口, 谈及 至 读 定时 和 busy waveform.
19. 测试 情况 使用 是 加载 1.
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