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资料编号:983780
 
资料名称:HCTL-2016
 
文件大小: 319K
   
说明
 
介绍:
Quadrature Decoder/Counter Interface ICs
 
 


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运动 感觉到
和 控制
图示 7. simplified 数字的 噪音 过滤 逻辑.
quadrature 解码器
这 quadrature 解码器 decodes
这 新当选的 filtered 信号 在
计数 信息. 这个 电路系统
multiplies 这 决议 的 这
输入 信号 用 一个 因素 的 四
(4x 解码). 当 使用 一个
encoder 为 运动 感觉到, 这
用户 益处 从 这 增加
决议 用 正在 能 至
提供 更好的 系统 控制.
这 quadrature 解码器 样本
这 输出 的 这 cha 和 chb
过滤. 为基础 在 这 past 二进制的
状态 的 这 二 信号 和 这
呈现 状态, 它 输出 一个 计数
信号 和 一个 方向 信号 至
这 内部的 位置 计数器. 在
这 情况 的 这 hctl-2020, 这
信号 也 go 至 外部 管脚 5
和 16 各自.
图示 9 显示 这 quadrature
states 和 这 有效的 状态 transi-
tions. 频道 一个 leading 频道
b 结果 在 counting 向上. 频道
b leading 频道 一个 结果 在
counting 向下. illegal 状态
transitions, 造成 用 faulty
encoders 或者 噪音 severe 足够的
至 通过 通过 这 过滤, 将
生产 一个 erroneous 计数.
设计 仔细考虑
这 设计者 应当 是 知道
那 这 运作 的 这 数字的
过滤 places 一个 定时 constraint
在 这 relationship 在
新当选的 quadrature 信号 和
这 外部 时钟. 图示 8
显示 这 定时 波形 和
一个 incremental encoder 输入.
自从 一个 输入 有 至 是 稳固的
为 三 rising 时钟 edges, 这
encoder 脉冲波 宽度 (t
E
- 低 或者
高) 有 至 是 更好 比 三
时钟 时期 (3t
CLK
). 这个
guarantees 那 这 异步的
输入 将 是 稳固的 在 三
consecutive rising 时钟 edges. 一个
realistic 设计 也 有 至 引领
图示 8. 信号 传播 通过 数字的 噪音 过滤.
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