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资料编号:1131221
 
资料名称:ADG849
 
文件大小: 908K
   
说明
 
介绍:
3 V/5 V CMOS 0.5 Ω SPDT/2:1 Mux in SC70
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
ADG849
rev. 0| 页 6 的 12
管脚 配置 和 function 描述
顶 视图
(不 至 规模)
6
5
4
1
2
3
S2
ADG849
V
DD
D
S1
04737-0-002
图示 2. 管脚 配置
表格 5. terminology
mnemonic 函数
V
DD
大多数 积极的 电源 供应 潜在的.
地面 (0 v) 涉及.
I
DD
积极的 供应 电流.
S 源 终端. 将 是一个 输入 或者 输出.
D 流 终端. 将 是 一个 输入 或者 输出.
逻辑 控制 输入.
R
ohmic 阻抗 在 d 和 s.
R
在-阻抗 相一致 在 任何 二 途径 i.e., r
最大 至 r
最小.
R
flat(在)
flatness 是 定义 作 这 区别 在 这 最大和 最小 值 的 在 阻抗 作 量过的 在 这
指定 相似物 信号 范围.
I
S
(止) 源 泄漏 电流 和 这 转变 止.
I
D
, i
S
(在) 频道 泄漏 电流 和 这 转变 在.
V
D
(v
S
) 相似物 电压 在 terminals d, s.
V
INL
最大 输入 电压 为 逻辑 0.
V
INH
最小 输入 电压 为 逻辑 1.
I
INL
(i
INH
) 输入 电流 的 这 数字的 输入.
C
S
(止) 止 转变 源 电容. 量过的 和 涉及 至 地面.
C
D
, c
S
(在) 在 转变 电容. 量过的 和 涉及 至 地面.
t
延迟 时间 在 这 50% 和 90% 点 的这 数字的 输入 和 转变 在 情况.
t
延迟 时间 在 这 50% 和 90% 点 的 这 数字的 输入 和 转变 止 情况.
t
BBM
在 或者 止 时间 量过的 在 这 80% 点 的 两个都 switches 当 切换 从 一个 至 另一.
承担
Injection
一个 measure 的 这 glitch impulse transfered 从 这 digital 输入 至 这 相似物 输出 在 切换.
串扰 一个 measure 的 unwanted 信号 那 是 结合 通过从 一个 频道 至 另一 作 一个 结果 的 parasitic capacitance.
止 分开 一个 measure 的 unwanted 信号 连接 通过 一个 止 转变.
带宽 这 频率 在 这个 the 输出 是 attenuated 用 3 db.
在-回馈 这 频率 回馈 的 这 在 转变.
嵌入 丧失 这 丧失 预定的 至 这 在-阻抗 的 这 转变.
thd + n 这 比率 的 调和的 amplitudes 加 这 噪音 的 一个 信号 至 这 基本的.
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