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资料编号:248116
 
资料名称:AD5323BRU
 
文件大小: 227.36K
   
说明
 
介绍:
+2.5 V to +5.5 V, 230 uA, Dual Rail-to-Rail Voltage Output 8-/10-/12-Bit DACs
 
 


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rev. 0
ad5303/ad5313/ad5323
9
I
DD
一个
频率
0
100 150 400200 250 350300
V
DD
= +5v
V
DD
= +3v
图示 14. I
DD
histogram 和 v
DD
=
+3 v 和 v
DD
= +5 v
V
DD
伏特
I
DD
一个
600
0
2.5 3 5.5
3.5 4
300
200
100
500
4.5 5
两个都 dacs 在 增益-的-二 模式
涉及 输入 缓冲
400
40
C
+25
C
+105
C
图示 17. 供应 电流 vs. 供应
电压
ch1 1v, ch2 5v, 时间 根基 = 5
s/div
CH2
CH1
CLK
V
输出
V
DD
= +5v
T
一个
= +25
C
图示 20. half-规模 安排好 (1/4 至
3/4 规模 代号 改变)
下沉/源 电流
毫安
V
输出
伏特
5
0
01
23
3
2
1
4
456
5v 源
3v 源
3v 下沉
5v 下沉
图示 15. 源 和 下沉 电流
能力
V
DD
伏特
1.0
0.9
0
2.7 3.2 5.23.7 4.2 4.7
0.4
0.3
0.2
0.1
0.8
0.6
0.7
0.5
两个都 dacs 在
三-状态 情况
40
C
+25
C
+105
C
I
DD
一个
图示 18. 电源-向下 电流 vs.
供应 电压
ch1 1v, ch2 1v, 时间 根基 = 20
s/div
CH2
CH1
V
DD
V
输出
一个
T
一个
= +25
C
图示 21. 电源-在 重置 至 0 v
I
DD
一个
600
0
零-规模 全部-规模
200
100
500
400
300
T
一个
= +25
C
V
DD
= +5v
图示 16. 供应 电流 vs. 代号
V
逻辑
伏特
700
100
0 0.5 4.5
1.5 2.5 3.5
400
300
600
500
I
DD
一个
1.0 2.0 3.0 4.0 5.0
200
T
一个
= +25
C
V
DD
= +5v
V
DD
= +3v
图示 19. 供应 电流 vs. 逻辑
输入 电压
ch1 1v, ch3 5v, 时间 根基 = 1
s/div
CH3
CH1
CLK
T
一个
= +25
C
图示 22. exiting 电源-向下 至
Midscale
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