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资料编号:920475
 
资料名称:AD7884AN
 
文件大小: 319K
   
说明
 
介绍:
LC2MOS 16-Bit, High Speed Sampling ADCs
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
ad7884/ad7885
rev. c
–11–
如果 这 噪音 在 这 转换器 是 too 高 为 一个 应用, 它 能
是 减少 用 oversampling 和 数字的 过滤. 这个 involves
抽样 这 输入 在 高等级的 比 这 必需的 文字 比率 和
然后 averaging 至 arrive 在 这 最终 结果. 这 非常 快 变换器-
sion 时间 的 这 ad7884/ad7885 制造 它 非常 合适的 为
oversampling. 为 例子, 如果 这 必需的 输入 带宽 是
40 khz, 这 ad7884/ad7885 可以 是 oversampled 用 一个 因素
的 2. 这个 产量 一个 3 db 改进 在 这 有效的 snr 每-
formance. 这 噪音 效能 在 这
±
5 volt 输入 范围 是
now effectively 85
µ
v rms 和 这 resultant 展开 的 代号 为
2500 conversions 将 是 四. 这个 是 显示 在 图示 15.
1500
0
1000
500
代号 频率
(x – 1) (x) (x + 1) (x + 2)
代号
图示 15. histogram 的 2500 conversions 的 一个 直流 输入
使用 一个
×
2 oversampling 比率
动态 效能
和 一个 联合的 转换 和 acquisition 时间 的 6
µ
s, 这
ad7884/ad7885 是 完美的 为 宽 带宽 信号 处理
产品. 信号 至 (噪音 + 扭曲量), 总的 调和的
扭曲量, 顶峰 调和的 或者 spurious 噪音 和 intermodula-
tion 扭曲量是 所有 指定. 图示 16 显示 一个 典型
fft plot 的 一个 1.8 khz,
±
5 v 输入 之后 正在digitized 用 这
ad7884/ad7885.
0
–150
–60
–120
–90
–30
2048 要点 fft
dB
f = 1.8khz,
±
5v sine 波
f = 163khz
snr = 87db
thd = –95db
样本
图示 16. ad7884/ad7885 fft plot
有效的 号码 的 位
这 formula 为 snr (看 terminology 部分) 是 related 至
这 决议 或者 号码 的 位 在 这 转换器. rewriting 这
formula, 在下, 给 一个 measure 的 效能 表示 在
有效的 号码 的 位 (n).
N
= (
SNR
– 1.76)/6.02
16
10
80
13
11
20
12
0
15
14
6040
频率 – khz
有效的 号码 的 位
图示 17. 有效的 号码 的 位 vs. 频率
这 有效的 号码 的 位 为 一个 设备 能 是 计算 从
它的 量过的 snr. 图示 17 显示 一个 典型 plot 的 有效的
号码 的 位 相比 频率 为 这 ad7884. 这 抽样
频率 是 166 khz.
微处理器 接合
这 ad7884/ad7885 是 设计 在 一个 高 速 处理
这个 结果 在 非常 快 接合 定时 (数据 进入 时间
的 57 ns 最大值). 这 ad7884 有 一个 全部 16-位 并行的 总线, 和
这 ad7885 有 一个 8-位 宽 总线. 这 ad7884, 和 它的 paral-
lel 接口, 是 suited 至 16-位 并行的 machines whereas 这
ad7885, 和 它的 字节 接口, 是 suited 至 8-位 machines.
一些 examples 的 典型 接口 配置 follow.
ad7884 至 mc68000 接口
图示 18 显示 一个 一般 接口 图解 为 这 mc68000,
16-位 微处理器 至 这 ad7884. 在 图示 18, 转换
是 initiated 用 bringing
CSA
低 (i.e., writing 至 这 适合的
地址). 这个 准许 这 处理器 至 维持 控制 在 这
完全 转换 处理. 在 一些 具体情况 它 将 是 更多
desirable 至 控制 转换 独立 从 这 处理器.
这个 能 是 完毕 用 使用 一个 外部 抽样 计时器.
MC68000
AD7884
地址
decode 逻辑
CONVST
CS
RD
db15 – db0
r/w
数据 总线
地址 总线
a23 – a1
d15 – d0
DTACK
CSA
CSB
图示 18. ad7884 至 mc68000 接口
once 转换 有 被 started, 这 处理器 必须 wait 直到
它 是 完成 在之前 读 这 结果. 那里 是 二 方法 的
ensuring 这个. 这 第一 方法 是 至 simply 使用 一个 软件 延迟 至
wait 为 6.5
µ
s 在之前 bringing
CS
RD
低 至 读 这 数据.
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