IDT72V36110L10PF_集成电路资料查询网

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商业的 和 工业的
温度 范围
idt72v3640/50/60/70/80/90/110 3.3v 高 密度 supersync ii
TM
36-位 先进先出
1,024 x 36, 2,048 x 36, 4,096 x 36, 8,192 x 36, 16,384 x 36, 32,768 x 36, 65,536 x 36, 131,072 x 36
4667 drw04
330
Ω
30pF*
510
Ω
3.3v
d.u.t.
输入 脉冲波 水平 地至3.0v
输入 上升/下降 时间 3ns
(1)
输入 定时 涉及 水平 1.5v
输出 涉及 水平 1.5v
输出 加载 为 t
CLK
= 10ns, 15 ns 看 图示 2a
输出 加载 为 t
CLK
= 7.5ns 看 图示 2b &放大; 2c

图示 2b. 交流 测试 加载
图示 2c. lumped 电容的 加载, 典型 减额

图示 2a. 输出 加载
* 包含 jig 和 scope capacitances.

便条:
1. 为 133mhz 运作 输入 上升/下降 时间 是 1.5ns.
4667 drw04a
50
Ω
1.5v
i/o
Z
0
= 50
Ω
4667 drw04b
6
5
4
3
2
1
20 30 50 80 100 200
电容 (pf)
t
CD
(典型, ns)

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8 商业的和工业的温度范围 idt72v3640/50/60/70/80/90/110 3.3v 高密度 supersync ii TM 36-位先进先出 1,024 x 36, 2,048 x 36, 4,096 x 36, 8,192 x 36, 16,384 x 36, 32,768 x 36, 65,536 x 36, 131,072 x 36 4667 drw04 330 Ω 30pF* 510 Ω 3.3v d.u.t. 输入脉冲波水平地至3.0v 输入上升/下降时间 3ns (1) 输入定时涉及水平 1.5v 输出涉及水平 1.5v 输出加载为 t CLK = 10ns, 15 ns 看图示 2a 输出加载为 t CLK = 7.5ns 看图示 2b &放大; 2c  图示 2b. 交流测试加载图示 2c. lumped 电容的加载, 典型减额  图示 2a. 输出加载 * 包含 jig 和 scope capacitances.  便条: 1. 为 133mhz 运作输入上升/下降时间是 1.5ns. 4667 drw04a 50 Ω 1.5v i/o Z 0 = 50 Ω 4667 drw04b 6 5 4 3 2 1 20 30 50 80 100 200 电容 (pf) t CD (典型, ns)

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