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ADS8324
11
SBAS172A
www.德州仪器.com
图示 7 显示 这 电流 消耗量 的 这 ads8324
相比 样本 比率. 为 这个 图表, 这 转换器 是 clocked
在 1.2mhz regardless 的 这 样本 rate—cs 是 高 为
这 remaining 样本 时期. 图示 8 也 显示 电流
消耗量 相比 样本 比率. 不管怎样, 在 这个 情况, 这
dclock 时期 是 1/24
th
的 这 样本 period—cs 是
高 为 一个 dclock 循环 输出 的 每 16.
那里 是 一个 重要的 distinction 在 这 电源-向下
模式 那 是 entered 之后 一个 转换 是 完全 和 这
全部 电源-向下 模式 那 是 使能 当 cs 是 高. cs
低 将 shut 向下 仅有的 这 相似物 部分. 这 数字的
部分 是 完全地 关闭 仅有的 当 cs 是 高.
因此, 如果 cs 是 left 低 在 这 终止 的 一个 转换 和 这
转换器 是 continually clocked, 这 电源 消耗量
将 不 是 作 低 作 当 cs 是 高, 显示 在 图示 9.
图示 7. 维持 f
CLK
在 这 最高的 可能 比率
准许 供应 电流 至 漏出 成直线地 和
样本 比率.
图示 8. 范围调整 f
CLK
减少 供应 电流 仅有的
slightly 和 样本 比率.
图示 9. 关闭 电流 和 cs 高 是 50na
典型地, regardless 的 这 时钟. 关闭
电流 和 cs 低 varies 和 样本
比率.
布局
为 最佳的 效能, 小心 应当 是 带去 和 这
物理的 布局 的 这 ads8324 电路系统. 这个 将 是
特别 真实 如果 这 涉及 电压 是 低 和/或者 这
转换 比率 是 高. 在 一个 50khz 转换 比率, 这
ads8324 制造 一个 位 decision 每 213ns. 那 是, 为 各自
subsequent 位 decision, 这 数字的 输出 必须 是 updated
和 这 结果 的 这 last 位 decision, 这 电容 排列
appropriately 切换 和 charged, 和 这 输入 至 这
比较器 settled 至 一个 14-位 水平的 所有 在里面 一个 时钟
循环.
这 基本 sar architecture 是 敏感的 至 尖刺 在 这
电源 供应, 涉及, 和 地面 连接 那 出现
just 较早的 至 闭锁 这 比较器 输出. 因此, 在
任何 单独的 转换 为 一个 n-位 sar 转换器, 那里 是
n “windows” 在 这个 大 外部 瞬时 电压 能
容易地 影响 这 转换 结果. 此类 尖刺 might origi-
nate 从 切换 电源 供应, 数字的 逻辑, 和 高
电源 设备, 至 名字 一个 few. 这个 particular 源 的 错误
能 是 非常 difficult 至 追踪 向下 如果 这 glitch 是 almost
同步的 至 这 转换器’s dclock signal—as 这
阶段 区别 在 这 二 改变 和 时间 和
温度, 造成 sporadic misoperation.
和 这个 在 mind, 电源 至 这 ads8324 应当 是 clean
和 好 绕过. 一个 0.1
µ
f 陶瓷的 绕过 电容 应当
是 放置 作 关闭 至 这 ads8324 包装 作 可能. 在
增加, 一个 1
µ
f 至 10
µ
f 电容 和 一个 5
Ω
或者
10
Ω
序列
电阻 将 是 使用 至 低-通过 过滤 一个 嘈杂的 供应.
这 涉及 应当 是 similarly 绕过 和 一个 0.1
µ
F
电容. 又一次, 一个 序列 电阻 和 大 电容 能 是
使用 至 低-通过 过滤 这 涉及 电压. 如果 这 涉及
电压 originates 从 一个 运算 放大, 是 细致的 那 这 运算
10000
1000
100
10
供应 电流 (
µ
一个)
0.1 1 10 100
样本 比率 (khz)
T
一个
= 25
°
C
V
CC
= 1.8v
V
REF
= 0.9v
f
CLK
= 2.4mhz
10000
1000
100
10
供应 电流 (
µ
一个)
0.1 1 10 100
样本 比率 (khz)
T
一个
= 25
°
C
V
CC
= 1.8v
V
REF
= 0.9v
f
CLK
= 24
•
f
样本
10000
1000
800
600
400
200
0.250
0.00
供应 电流 (
µ
一个)
0.1 1 10 100
样本 比率 (khz)
T
一个
= 25
°
C
V
CC
= 1.8v
V
REF
= 0.9v
f
CLK
= 24
•
f
样本
cs 低 (地)
cs 高 (v
CC
)

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ADS8324 11 SBAS172A www.德州仪器.com 图示 7 显示这电流消耗量的这 ads8324 相比样本比率. 为这个图表, 这转换器是 clocked 在 1.2mhz regardless 的这样本 rate—cs 是高为这 remaining 样本时期. 图示 8 也显示电流消耗量相比样本比率. 不管怎样, 在这个情况, 这 dclock 时期是 1/24 th 的这样本 period—cs 是高为一个 dclock 循环输出的每 16. 那里是一个重要的 distinction 在这电源-向下模式那是 entered 之后一个转换是完全和这全部电源-向下模式那是使能当 cs 是高. cs 低将 shut 向下仅有的这相似物部分. 这数字的部分是完全地关闭仅有的当 cs 是高. 因此, 如果 cs 是 left 低在这终止的一个转换和这转换器是 continually clocked, 这电源消耗量将不是作低作当 cs 是高, 显示在图示 9. 图示 7. 维持 f CLK 在这最高的可能比率准许供应电流至漏出成直线地和样本比率. 图示 8. 范围调整 f CLK 减少供应电流仅有的 slightly 和样本比率. 图示 9. 关闭电流和 cs 高是 50na 典型地, regardless 的这时钟. 关闭电流和 cs 低 varies 和样本比率. 布局为最佳的效能, 小心应当是带去和这物理的布局的这 ads8324 电路系统. 这个将是特别真实如果这涉及电压是低和/或者这转换比率是高. 在一个 50khz 转换比率, 这 ads8324 制造一个位 decision 每 213ns. 那是, 为各自 subsequent 位 decision, 这数字的输出必须是 updated 和这结果的这 last 位 decision, 这电容排列 appropriately 切换和 charged, 和这输入至这比较器 settled 至一个 14-位水平的所有在里面一个时钟循环. 这基本 sar architecture 是敏感的至尖刺在这电源供应, 涉及, 和地面连接那出现 just 较早的至闭锁这比较器输出. 因此, 在任何单独的转换为一个 n-位 sar 转换器, 那里是 n “windows” 在这个大外部瞬时电压能容易地影响这转换结果. 此类尖刺 might origi- nate 从切换电源供应, 数字的逻辑, 和高电源设备, 至名字一个 few. 这个 particular 源的错误能是非常 difficult 至追踪向下如果这 glitch 是 almost 同步的至这转换器’s dclock signal—as 这阶段区别在这二改变和时间和温度, 造成 sporadic misoperation. 和这个在 mind, 电源至这 ads8324 应当是 clean 和好绕过. 一个 0.1 µ f 陶瓷的绕过电容应当是放置作关闭至这 ads8324 包装作可能. 在增加, 一个 1 µ f 至 10 µ f 电容和一个 5 Ω 或者 10 Ω 序列电阻将是使用至低-通过过滤一个嘈杂的供应. 这涉及应当是 similarly 绕过和一个 0.1 µ F 电容. 又一次, 一个序列电阻和大电容能是使用至低-通过过滤这涉及电压. 如果这涉及电压 originates 从一个运算放大, 是细致的那这运算 10000 1000 100 10 供应电流 ( µ 一个) 0.1 1 10 100 样本比率 (khz) T 一个 = 25 ° C V CC = 1.8v V REF = 0.9v f CLK = 2.4mhz 10000 1000 100 10 供应电流 ( µ 一个) 0.1 1 10 100 样本比率 (khz) T 一个 = 25 ° C V CC = 1.8v V REF = 0.9v f CLK = 24 • f 样本 10000 1000 800 600 400 200 0.250 0.00 供应电流 ( µ 一个) 0.1 1 10 100 样本比率 (khz) T 一个 = 25 ° C V CC = 1.8v V REF = 0.9v f CLK = 24 • f 样本 cs 低 (地) cs 高 (v CC )

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