DAC1232LCN_集成电路资料查询网

TLH5690
微观的-dac DAC1208DAC1209DAC1210DAC1230DAC1231DAC1232
12-bit
m
P Compatible 翻倍-缓冲 D 至 一个 转换器
二月 1995
微观的-dac
TM
DAC1208DAC1209DAC1210DAC1230
DAC1231DAC1232 12-bit
m
P Compatible
翻倍-缓冲 D 至 一个 转换器
一般 描述
这 DAC1208 和 这 DAC1230 序列 是 12-位 乘以-
ing D 至 一个 转换器 设计 至 接口 直接地 和 一个
宽 多样性 的 微处理器 (8080 8048 8085 z-80
etc) 翻倍 buffering 输入 寄存器 和 有关联的 con-
trol 线条 准许 这些 DACs 至 呈现 作 一个 二-字节 ‘‘stack’’
在 这 system’s 记忆 或者 IO 空间 和 非 额外的 在-
terfacing 逻辑 required
这 DAC1208 序列 提供 所有 12 输入 线条 至 准许 sin-
gle buffering 为 最大 throughput 当 使用 和 16-位
processors 这些 输入 线条 能 也 是 externally config-
ured 至 准许 一个 8-位 数据 interface 这 DAC1230 序列
能 是 使用 和 一个 8-位 数据 总线 直接地 作 它 内部
formulates 这 12-位 DAC 数据 从 它的 8 输入 lines 所有 的
这些 DACs 接受 left-justified 数据 从 这 processor
这 相似物 部分 是 一个 精确 硅-chromium (si-cr)
r-2r ladder 网络 和 twelve CMOS 电流 switches
一个 inverted r-2r ladder 结构 是 使用 和 这 二进制的
weighted 电流 切换 在 这 I
OUT1
和 I
OUT2
维持 一个 常量 电流 在 各自 ladder leg indepen-
dent 的 这 转变 state 特定的 电路系统 提供 TTL 逻辑
输入 电压 水平的 compatibility
这 DAC1208 序列 和 DAC1230 序列 是 这 12-位
members 的 一个 家族 的 微处理器 兼容 DACs
(微观的-dacs
TM
) 为 产品 需要 其它 resolu-
tions 这 DAC1000 序列 为 10-位 和 DAC0830 序列
为 8-位 是 有 alternatives
特性
Y
线性 指定 和 零 和 全部-规模 调整 仅有的
Y
直接 接口 至 所有 popular 微处理器
Y
翻倍-buffered 单独的-缓冲 或者 流动 通过 数字的
数据 输入
Y
逻辑 输入 这个 满足 TTL 电压 水平的 规格 (14v
逻辑 门槛)
Y
工作 和
g
10V referencefull 4-quadrant
multiplication
Y
运作 保卫-alone (没有
m
p) 如果 desired
Y
所有 部分 有保证的 12-位 monotonic
Y
DAC1230 序列 是 管脚 兼容 和 这 DAC0830
序列 8-位 微观的-dacs
关键 规格
Y
电流 安排好 时间 1
m
s
Y
决议 12 位
Y
线性 (有保证的
在 温度) 10 11 或者 12 位 的 FS
Y
增益 Tempco 13 ppm

C
Y
低 电源 消耗 20 mW
Y
单独的 电源 供应 5 V
直流
至 15 V
直流
典型 应用
TLH5690–1
触发-状态

是 一个 注册 商标 的 国家的 半导体 Corp
微观的-dac
TM
是 一个 商标 的 国家的 半导体 Corp
C
1995 国家的 半导体 公司 rrd-b30m115printed 在 U S A

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TLH5690 微观的-dac DAC1208DAC1209DAC1210DAC1230DAC1231DAC1232 12-bit m P Compatible 翻倍-缓冲 D 至一个转换器二月 1995 微观的-dac TM DAC1208DAC1209DAC1210DAC1230 DAC1231DAC1232 12-bit m P Compatible 翻倍-缓冲 D 至一个转换器一般描述这 DAC1208 和这 DAC1230 序列是 12-位乘以- ing D 至一个转换器设计至接口直接地和一个宽多样性的微处理器 (8080 8048 8085 z-80 etc) 翻倍 buffering 输入寄存器和有关联的 con- trol 线条准许这些 DACs 至呈现作一个二-字节 ‘‘stack’’ 在这 system’s 记忆或者 IO 空间和非额外的在- terfacing 逻辑 required 这 DAC1208 序列提供所有 12 输入线条至准许 sin- gle buffering 为最大 throughput 当使用和 16-位 processors 这些输入线条能也是 externally config- ured 至准许一个 8-位数据 interface 这 DAC1230 序列能是使用和一个 8-位数据总线直接地作它内部 formulates 这 12-位 DAC 数据从它的 8 输入 lines 所有的这些 DACs 接受 left-justified 数据从这 processor 这相似物部分是一个精确硅-chromium (si-cr) r-2r ladder 网络和 twelve CMOS 电流 switches 一个 inverted r-2r ladder 结构是使用和这二进制的 weighted 电流切换在这 I OUT1 和 I OUT2 维持一个常量电流在各自 ladder leg indepen- dent 的这转变 state 特定的电路系统提供 TTL 逻辑输入电压水平的 compatibility 这 DAC1208 序列和 DAC1230 序列是这 12-位 members 的一个家族的微处理器兼容 DACs (微观的-dacs TM ) 为产品需要其它 resolu- tions 这 DAC1000 序列为 10-位和 DAC0830 序列为 8-位是有 alternatives 特性 Y 线性指定和零和全部-规模调整仅有的 Y 直接接口至所有 popular 微处理器 Y 翻倍-buffered 单独的-缓冲或者流动通过数字的数据输入 Y 逻辑输入这个满足 TTL 电压水平的规格 (14v 逻辑门槛) Y 工作和 g 10V referencefull 4-quadrant multiplication Y 运作保卫-alone (没有 m p) 如果 desired Y 所有部分有保证的 12-位 monotonic Y DAC1230 序列是管脚兼容和这 DAC0830 序列 8-位微观的-dacs 关键规格 Y 电流安排好时间 1 m s Y 决议 12 位 Y 线性 (有保证的在温度) 10 11 或者 12 位的 FS Y 增益 Tempco 13 ppm  C Y 低电源消耗 20 mW Y 单独的电源供应 5 V 直流至 15 V 直流典型应用 TLH5690–1 触发-状态  是一个注册商标的国家的半导体 Corp 微观的-dac TM 是一个商标的国家的半导体 Corp C 1995 国家的半导体公司 rrd-b30m115printed 在 U S A

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