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资料编号:1078280
 
资料名称:ADS7832
 
文件大小: 217156K
   
说明
 
介绍:
Single-Ended Data Acquisition System
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
9
ADS7832
®
t
12
d0 - d7
HBE
SFR
RD
CS
BUSY
低 字节 数据 高 字节 数据
t
11
t
12
t
11
t
13
t
14
t
13
t
14
hi-zhi-z 状态
t
8
t
7
t
10
t
9
t
8
t
10
笔直地 二进制的 (和 0v = 000 十六进制, 5v = fff 十六进制), 和 这
数据 是 提交 在 一个 正确的-justified format (和 这 lsb 作
这 大多数 正确的 位 在 这 16-位 文字). 二 读 行动
是 必需的 至 转移 这 高 字节 和 低 字节, 和 这
字节 是 提交 符合 至 这 输入 水平的 在 这 高
字节 使能 管脚 (hbe).
图示 4. 读 循环 定时.
图示 3. 写 循环 定时 (为 初始的 转换 或者 校准).
图示 2. 转换器 定时.
这 字节 能 是 读 在 也 顺序, 取决于 在 这 状态
的 这 hbe 输入. 如果 hbe 改变 当 cs 和 rd 是
低, 这 输出 数据 将 改变 至 correspond 至 这 hbe
输入. 图示 4 显示 这 定时 为 读 第一 这 低
字节 和 然后 这 高 字节.
WR
BUSY
CLK
1234567161718
多路调制器 安排好,
补偿 自动 zeroing
和 抽样 acquisition
Successive
Approximation
转换
t
6
t
2
a0, a1
SFR
BUSY
wr 或者 cal
CS
V
IL
V
IH
t
3
t
5
t
4
t
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