Bank
号码
vref bank 管脚 名字/函数 optional 函数(s) 配置
函数
F484 B672 F672 F780 dqs 为 x16 dqs 为 x32
DIFFIO
速 (1)
管脚 信息 为 这 stratix™ ep1s20 设备, ver 3.6
(便条 2)
B8 VREF1B8 IO DQ7B5 V17 AD8 AD8 AG21 DQ2B13 DQ1B13
B8 VREF1B8 IO DQ7B4 V16 AE8 AE8 AF21 DQ2B12 DQ1B12
B8 VREF1B8 IO DQ7B3 Y16 AF8 AF8 AE20 DQ2B11 DQ1B11
B8 VREF1B8 IO DQS7B AA16 Y9 Y9 AG20 DQS1B
B8 VREF1B8 IO DQ7B2 T16 Y8 Y8 AF20 DQ2B10 DQ1B10
B8 VREF1B8 IO DQ6B7 Y15 AC9 AC9 AE19 DQ2B7 DQ1B7
B8 VREF1B8 IO DQ7B1 W16 W9 W9 AH21 DQ2B9 DQ1B9
B8 VREF1B8 IO DQ6B6 AA15 AF9 AF9 AD19 DQ2B6 DQ1B6
B8 VREF1B8 IO DQ7B0 AB16 AA8 AA8 AH20 DQ2B8 DQ1B8
B8 VREF1B8 IO DQ6B5 AB15 AD10 AD10 AF19 DQ2B5 DQ1B5
B8 VREF1B8 VREF1B8 R16 AE9 AE9 AD20
B8 VREF1B8 IO DQ6B4 V15 AE10 AE10 AG19 DQ2B4 DQ1B4
B8 VREF1B8 IO DQ6B3 U15 AC10 AC10 AH19 DQ2B3 DQ1B3
B8 VREF1B8 IO DQS6B W15 Y10 Y10 AF18 DQS2B
B8 VREF1B8 IO PGM2 R15 AA9 AA9 AB19
B8 VREF1B8 IO FCLK3 P16 AD9 AD9 AC21
B8 VREF1B8 IO FCLK2 T15 AB9 AB9 AC19
B8 VREF1B8 IO DQ6B2 U14 AA10 AA10 AD18 DQ2B2 DQ1B2
B8 VREF1B8 IO crc_错误 N14 W10 W10 AA20
B8 VREF1B8 IO DQ6B1 W14 AB10 AB10 AE18 DQ2B1 DQ1B1
B8 VREF1B8 IO DQ6B0 V14 AF10 AF10 AG18 DQ2B0 DQ1B0
B8 VREF1B8 IO RDN8 P15 AB11 AB11 Y19
B8 VREF1B8 IO RUP8 N15 AE11 AE11 W19
B8 VREF1B8 IO DQ5B7 AF17
B8 VREF1B8 IO DQ5B6 AG17
B8 VREF1B8 IO DQ5B5 AE17
B8 VREF1B8 IO DQ5B4 AD17
B8 VREF1B8 IO RDYnBSY P14 AC11 AC11 AA19
B8 VREF1B8 IO DQ5B3 AG16
B8 VREF2B8 IO DQS5B AH16
pt-ep1s20-3.6
版权 © 2006 altera corp.
管脚 列表
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