VITESSE
半导体 公司
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数据 薄板
VSC8140
2.48832gb/s 16:1 sonet/sdh
transceiver 和 整体的 时钟 发生器
g52251-0, rev. 4.0
图示 7: 传统的 直流 末端 的 低-速 lvpecl rxout[15:0] 输出
这 rxout[15:0] 输出 驱动器 能 也 是 appropriately 交流-结合 用 一个 号码 的 方法, 如何-
总是, 直流-连接 是 preferred 自从 那里 是 非 保证 的 转变 密度 为 单独的 位 在 这 16-位
文字. 图示 8 illustrates 一个 交流-连接 方法 为 这 occasion 当 这 downstream 设备 提供 这
偏差 要点 为 交流-连接. 图示 9 illustrates 一个 交流-连接 方法 为 这 occasion 当 这 偏差 要点
needs 至 是 发生 externally. 这 电阻 值 在 图示 9 是 选择 至 发生 一个 偏差 要点 的 1.98v,
这 mid-要点 为 lvpecl v
OH
和 v
OL
作 指定 为 这 vsc8140. 电阻 值 应当 是 选择 至
发生 这 需要 偏差 要点 为 这 downstream 设备.
图示 8: 交流 末端 的 低-速 lvpecl rxout[15:0] 输出
VSC8140
Z
o
V
CC
-2v
r1 =50
Ω
VSC8140
Z
o
r1 = 50
Ω
V
CC
-2v
100nF
downstream
偏差 要点
发生
内部
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